k311-Kombinatorische_Schaltkreise_Gatter_Transistoren

Page 1

page-01.png

Kapitel 3 – Kombinatorische Logik

  1. Kombinatorische Schaltkreise
    1.1 Gatter, Transistoren
    1.2 Definition
  2. Boolesche Algebren
  3. Boolesche Ausdrücke, Normalformen, zweistufige Synthese
  4. Berechnung eines Minimalpolynoms
  5. Arithmetische Schaltungen
  6. Anwendung: ALU von ReTI

Albert-Ludwigs-Universität Freiburg
Prof. Dr. Armin Biere
Institut für Informatik

Page 2

page-02.png

Boolesche Funktionen

Definition: Eine Boolesche Funktion in Variablen und mit Ausgängen ist eine Funktion

Die Menge Boolescher Funktionen in Variablen mit Ausgängen ist

Wir schreiben abkürzend statt .

Page 3

page-03.png

Kombinatorische Schaltkreise

Ein kombinatorischer Schaltkreis (Schaltnetz) ist ein Modell für Hardware, die eine Boolesche Funktion () implementiert.

Ein kombinatorischer Schaltkreis für hat Eingänge und Ausgänge. Legt man an den Eingängen den Vektor an, berechnet der Schaltkreis den Vektor und stellt ihn an den Ausgängen bereit.

Es gibt weitere Arten von Hardware:

  • Sequentielle Logik mit speichernden Elementen (später).
  • Analog- und Mixed-Signal-Blöcke (nicht in TI).

Page 4

page-04.png

Kombinatorische Logiksynthese

Kombinatorische Logiksynthese ist das Problem, zu einer gegebenen Booleschen Funktion einen möglichst effizienten kombinatorischen Schaltkreis, d. h. einen mit möglichst geringen Kosten, zu finden.

Kosten hängen von der verwendeten Technologie ab und können sich auf die

  • Größe,
  • Verzögerung,
  • Energieverbrauch

des Schaltkreises beziehen und eventuell weitere Parameter (Zuverlässigkeit, Testbarkeit, ...) berücksichtigen.

Page 5

page-05.png

Technologien

Wir konzentrieren uns hier auf zwei Arten von Technologien:

  1. Programmierbare Logikfelder (Programmable Logic Arrays, PLAs).
    Implementieren sogenannte zweistufigen Realisierungen, siehe später (Kapitel 3.3).
  2. Mehrstufige Realisierungen mit allgemeinen Bibliothekszellen (Logik-Gattern).

(auf Englisch: "two-level" und "multi-level", und "gate" für "Gatter")

Page 6

page-06.png

Logikgatter

  • Gatter sind kleine kombinatorische Blöcke, in der Regel mit bis zu 4 Eingängen und einem Ausgang.
  • Gatter werden mit Transistoren realisiert.
  • Gatter können zu größeren Schaltungen verbunden werden.
  • Die Menge der verfügbaren Gatter ergibt eine Standardzellen-Bibliothek bzw. Gatter-Bibliothek.

Page 7

page-07.png

Einige wichtige Gatter

AND2
0 0 0
0 1 0
1 0 0
1 1 1
OR2
0 0 0
0 1 1
1 0 1
1 1 1
NOT
0 1
1 0
NAND2
0 0 1
0 1 1
1 0 1
1 1 0
NOR2
0 0 1
0 1 0
1 0 0
1 1 0
XOR2
0 0 0
0 1 1
1 0 1
1 1 0

Page 8

page-08.png

Logikgatter - verschiedene Notationen

Es gibt verschiedene Notationen für Logikgatter.

Gatter IEC ANSI DIN
OR2
NOT

Wir werden in dieser Vorlesung die ANSI-Notation verwenden.

Page 9

page-09.png

Transistoren

Einen Transistor kann man vereinfacht als spannungsgesteuerten Schalter sehen: Leitung (gate) regelt Leitfähigkeit zwischen Quelle und Senke.

p-Kanal Transistor

Senke Quelle
  • Leitet, wenn an eine 0 anliegt.
  • Sperrt, wenn an eine 1 anliegt.

n-Kanal Transistor

Senke Quelle
  • Leitet, wenn an eine 1 anliegt.
  • Sperrt, wenn an eine 0 anliegt.

Page 10

page-10.png

Realisierung von Gattern in CMOS-Technologie

Complementary Metal Oxide Semiconductor.
Es werden p- und n-Kanal-Transistoren verwendet.
Beispiel: CMOS-Inverter.

Page 11

page-11.png

Realisierung von Gattern in CMOS-Technologie

Complementary Metal Oxide Semiconductor.
Es werden p- und n-Kanal-Transistoren verwendet.
Beispiel: CMOS-Inverter.

n-Kanal-Transistor

Page 12

page-12.png

Realisierung von Gattern in CMOS-Technologie

Complementary Metal Oxide Semiconductor.
Es werden p- und n-Kanal-Transistoren verwendet.
Beispiel: CMOS-Inverter.

n-Kanal-Transistor
p-Kanal-Transistor

Page 13

page-13.png

Realisierung von Gattern in CMOS-Technologie

Complementary Metal Oxide Semiconductor.
Es werden p- und n-Kanal-Transistoren verwendet.
Beispiel: CMOS-Inverter.

n-Kanal-Transistor
p-Kanal-Transistor
→ Spannungsquelle

Page 14

page-14.png

Realisierung von Gattern in CMOS-Technologie

Complementary Metal Oxide Semiconductor.
Es werden p- und n-Kanal-Transistoren verwendet.
Beispiel: CMOS-Inverter.

n-Kanal-Transistor
p-Kanal-Transistor
→ Spannungsquelle
→ Masse

Page 15

page-15.png

Realisierung von Gattern in CMOS-Technologie

Complementary Metal Oxide Semiconductor.
Es werden p- und n-Kanal-Transistoren verwendet.
Beispiel: CMOS-Inverter.

n-Kanal-Transistor
p-Kanal-Transistor
→ Spannungsquelle
→ Masse

Page 16

page-16.png

Realisierung von Gattern in CMOS-Technologie

Complementary Metal Oxide Semiconductor.
Es werden p- und n-Kanal-Transistoren verwendet.
Beispiel: CMOS-Inverter.

n-Kanal-Transistor
p-Kanal-Transistor
→ Spannungsquelle
→ Masse

/

Page 17

page-17.png

CMOS-Inverter mit 1 am Gate

Leitender Pfad zwischen Ausgang und Masse (logische 0).


p-Kanal-Transistor
n-Kanal-Transistor

Page 18

page-18.png

CMOS-Inverter mit 1 am Gate

Leitender Pfad zwischen Ausgang und Masse (logische 0).


p-Kanal-Transistor
n-Kanal-Transistor

Page 19

page-19.png

CMOS-Inverter mit 1 am Gate

Leitender Pfad zwischen Ausgang und Masse (logische 0).


p-Kanal-Transistor
n-Kanal-Transistor


leitet

Page 20

page-20.png

CMOS-Inverter mit 1 am Gate

Leitender Pfad zwischen Ausgang und Masse (logische 0).


p-Kanal-Transistor
n-Kanal-Transistor


leitet / sperrt

Page 21

page-21.png

CMOS-Inverter mit 1 am Gate

Leitender Pfad zwischen Ausgang und Masse (logische 0).


p-Kanal-Transistor
n-Kanal-Transistor


leitet / sperrt

Page 22

page-22.png

CMOS-Inverter mit 1 am Gate

Leitender Pfad zwischen Ausgang und Masse (logische 0).


p-Kanal-Transistor
n-Kanal-Transistor


leitet / sperrt

Page 23

page-23.png

CMOS-Inverter mit 0 am Gate

Leitender Pfad zwischen Ausgang und Spannungsversorgung (logische 1).


p-Kanal-Transistor
n-Kanal-Transistor

Page 24

page-24.png

CMOS-Inverter mit 0 am Gate

Leitender Pfad zwischen Ausgang und Spannungsversorgung (logische 1).


p-Kanal-Transistor
n-Kanal-Transistor

Page 25

page-25.png

CMOS-Inverter mit 0 am Gate

Leitender Pfad zwischen Ausgang und Spannungsversorgung (logische 1).


p-Kanal-Transistor
n-Kanal-Transistor


sperrt

Page 26

page-26.png

CMOS-Inverter mit 0 am Gate

Leitender Pfad zwischen Ausgang und Spannungsversorgung (logische 1).


p-Kanal-Transistor
n-Kanal-Transistor


sperrt / leitet

Page 27

page-27.png

CMOS-Inverter mit 0 am Gate

Leitender Pfad zwischen Ausgang und Spannungsversorgung (logische 1).


p-Kanal-Transistor
n-Kanal-Transistor


sperrt / leitet

Page 28

page-28.png

CMOS-Inverter mit 0 am Gate

Leitender Pfad zwischen Ausgang und Spannungsversorgung (logische 1).


p-Kanal-Transistor
n-Kanal-Transistor


sperrt / leitet

Page 29

page-29.png

CMOS

Welche Funktion wird mit Hilfe der p-Kanal und n-Kanal Transistoren realisiert?

mit , , ,

Page 30

page-30.png

CMOS-NAND-Gatter

mit , , ,

Ausgang ist 0

  • Es existiert ein leitender Pfad von 0 zum Ausgang
  • beide n-Kanal-Transistoren leiten
  • ,

Ausgang ist 1

  • Es existiert ein leitender Pfad von 1 zum Ausgang
  • einer der p-Kanal-Transistoren leitet
  • oder ,

Page 31

page-31.png

Weitere CMOS-Gatter

  • Es gibt keine „direkte" Implementierung von AND- und OR-Gattern. Sie werden aus NAND-/NOR-Gattern plus Invertern zusammengesetzt.
  • Zu jedem p-Kanal Transistor gibt es stets einen komplementären n-Kanal-Transistor, der genau dann sperrt, wenn der erste Transistor leitet und umgekehrt.
  • Dadurch gibt es niemals einen leitenden Pfad von der Stromversorgung zur Masse. Dies reduziert Leistungsverluste.

Page 32

page-32.png

CMOS-Multiplexer mit Zwei Transmission-Gates

Transmission Gate leitet oder sperrt (hoch-ohmig / tri-state)

Implementierung von Bussen

, ,